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PIC18F6585/8585/6680/8680
DS30491C-page 238
2004 Microchip Technology Inc.
FIGURE 18-2:
USART TRANSMIT BLOCK DIAGRAM
FIGURE 18-3:
ASYNCHRONOUS TRANSMISSION
FIGURE 18-4:
ASYNCHRONOUS TRANSMISSION (BACK TO BACK)
TXIF
TXIE
Interrupt
TXEN
Baud Rate CLK
SPBRG
Baud Rate Generator
TX9D
MSb
LSb
Data Bus
TXREG Register
TSR Register
(8)
0
TX9
TRMT
SPEN
RC6/TX/CK pin
Pin Buffer
and Control
8
SPBRGH
BRG16
Word 1
Transmit Shift Reg
Start bit
bit 0
bit 1
bit 7/8
Write to TXREG
Word 1
BRG Output
(Shift Clock)
RC6/TX/CK
TXIF bit
(Transmit Buffer
Reg. Empty Flag)
TRMT bit
(Transmit Shift
Reg. Empty Flag)
1 TCY
(pin)
Stop bit
Transmit Shift Reg.
Write to TXREG
BRG Output
(Shift Clock)
RC6/TX/CK
TXIF bit
(Interrupt Reg. Flag)
TRMT bit
(Transmit Shift
Reg. Empty Flag)
Word 1
Word 2
Word 1
Word 2
Stop bit
Start bit
Transmit Shift Reg.
Word 1
Word 2
bit 0
bit 1
bit 7/8
bit 0
Note:
This timing diagram shows two consecutive transmissions.
1 TCY
(pin)
Start bit
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